El ingeniero de DFT ( diseño para prueba ) es responsable de realizar las tareas mencionadas a continuación:
- Generación de pruebas estructurales para diferentes modelos de fallas, a saber, fallas atascadas, fallas de retraso de transición, fallas de retraso de ruta, etc.
- Memoria BIST (Self Test incorporado) generación y verificación de pruebas.
- Prueba de inserción de estructura que incluye exploración interna, exploración de límite superior / central, memoria y lógica BIST.
- Validación de simulación de las pruebas estructurales (ATPG).
- Análisis de fallas / depuración de fallas de simulación y ATE.
Para ver los diferentes modelos de fallas comúnmente utilizados para generar pruebas estructurales, vea también: la respuesta de Harpreet Singh Bedi a ¿Qué modelos de fallas se usan para probar los circuitos digitales en busca de fallas de fabricación?
PD No es raro que una docena o más ingenieros de DFT desarrollen pruebas para un solo SOC.
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